ПРОГРАММНОЕ ЯДРО МИКРОПРОЦЕССОРА RISC АРХИТЕКТУРЫ НА БАЗЕ ПРОГРАММИРУЕМОЙ ЛОГИЧЕСКОЙ ИНТЕГРАЛЬНОЙ СХЕМЫ (2024)
В данной статье рассматривается актуальная тема разработки и интеграции 8-разрядного RISC микропроцессора в программируемые логические интегральные схемы, совместимого с существующими микропроцессорами, например, семейства PIC. Основное внимание уделяется созданию микропроцессора, который не только соответствует требованиям современной микроэлектроники в плане энергопотребления и эффективности, но также предлагает удобные инструменты для компиляции и отладки. Авторы детально описывают методологию проектирования программного ядра микропроцессора на языке Verilog, основные принципы разработки микропроцессорных ядер для программируемых логических интегральных схем, а также подходы к синхронизации данных и интеграции периферийных устройств. Статья также включает
в себя описание архитектуры микропроцессора, его ключевых компонентов и функциональной схемы.
Представленные результаты демонстрируют преимущества интеграции микропроцессора в программируемую логическую интегральную схему, такие как возможность создания специализированных команд и систем на кристалле, гибкость в конфигурации периферии и упрощение процесса программирования. Обсуждение результатов подчеркивает перспективность использования разработанного микропроцессорного ядра в
различных областях, таких как встраиваемые системы, цифровое управление питанием и вычислительные синтезаторы. В заключение статьи приведены основные выводы по работе.